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    首頁產(chǎn)品索引ADF4196

    ADF4196

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    低相位噪聲,快速解決6 GHz 鎖相頻率合成器

    制造商:ADI/AD

    中文數(shù)據(jù)手冊

    產(chǎn)品信息

    優(yōu)勢和特點

      快速建立小數(shù)N分頻PLL結(jié)構(gòu)

      單個PLL可取代乒乓式頻率合成器

      在5 μs內(nèi)完成整個GSM頻段上的跳頻,相位建立時間低于20 μs

      相位誤差:1度rms (4 GHz RF輸出)

      數(shù)字可編程輸出相位

      數(shù)字可編程輸出相位

      RF輸入范圍最高可達6 GHz

      三線式串行接口

      片內(nèi)低噪聲差分放大器

      相位噪聲品質(zhì)因數(shù):–216 dBc/Hz

      利用ADIsimPLL可實現(xiàn)環(huán)路濾波器設計

    產(chǎn)品詳情

    ADF4196頻率合成器可以用來在無線接收機和發(fā)射機的上變頻和下變頻部分實現(xiàn)本振(LO),其結(jié)構(gòu)專門設計用來滿足基站的GSM/EDGE鎖定時間要求,其快速建立功能則使ADF4196非常適合脈沖多普勒雷達應用。

    ADF4196由低噪聲數(shù)字鑒頻鑒相器(PFD)和精密差分電荷泵組成。還有一個差分放大器,用來將電荷泵的差分輸出轉(zhuǎn)換為外部電壓控制振蕩器(VCO)的單端電壓。Σ-Δ型小數(shù)插值器與N分頻器一起使用,能夠?qū)崿F(xiàn)可編程模數(shù)小數(shù)N分頻。此外,4位參考(R)分頻器和片內(nèi)倍頻器允許PFD輸入端的參考信號(REFIN)頻率為可選值。

    如果頻率合成器與外部環(huán)路濾波器和VCO一起使用,則可以實現(xiàn)完整的鎖相環(huán)(PLL)。開關結(jié)構(gòu)確保PLL能在GSM時隙保護期間內(nèi)建立,而無需第二PLL及相關的隔離開關。與以前的乒乓式GSM PLL結(jié)構(gòu)相比,這種結(jié)構(gòu)能節(jié)省成本,降低復雜度,減小PCB面積,并減少屏蔽和特性測試工作。

    應用

      GSM/EDGE基站

      PHS基站

      脈沖多普勒雷達

      儀器儀表和測試設備

      波束形成/相控陣系統(tǒng)

    技術資料

    標題類型大?。↘B)下載
    AN-873: ADF4xxx系列PLL頻率合成器的鎖定檢測 (Rev. 0)PDF309 點擊下載
    AN-873: Lock Detect on the ADF4xxx Family of PLL Synthesizers (Rev. 0)PDF207 點擊下載
    UG-476: PLL Software Installation GuidePDF477 點擊下載

    應用案例更多案例

    系列產(chǎn)品索引查看所有產(chǎn)品

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